Aleksandr
Chi sono
Sviluppo IP per FPGA e CPLD, ambiente di test e documentazione personalizzata nei linguaggi verilog e systemverilog.
Aiutare gli studenti a risolvere problemi.
Il pagamento è contrattuale.
Ho lavorato con i seguenti FPGA e CPLD:
Altera (Intel)
Cyclone: II, IVE, IVGX, VGX, VST.
Arria: II, VST, VGX
MAX: II, V
Lattice
Crosslink, EPC3
Competenze 4
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